论文摘要
分支预测是影响微处理器性能的关键因素之一。在计算机学院微电子与微处理器研究所研制的一款高性能通用处理器(下称X微处理器)中,本人根据X微处理器的具体要求,优化设计了一款高速、低功耗、高精度的分支目标缓冲区(BTB)部件,并对其进行了全方位验证。 X微处理器试验样片投片测试结果表明,BTB部件工作正常,满足各方面性能指标。 研究工作完成的主要内容包括: (1) 在研究分析国外分支预测理论成果的基础上,针对X微处理器的设计要求,BTB部件采用前瞻型二级自适应算法并确定具体的实现框架。 (2) 通过理论分析,确定BTB存储单元阵列的设计方案。根据BTB部件的具体性能要求确定,细化了各子模块的具体实现,并给出性能分析。 (3) 针对BTB的设计要求,确定采用树状网络分布的时钟分布技术。深入探讨了时钟缓冲电路的最小延时和电路中反相器的最优尺寸。通过进一步深入分析,本文设计的BTB部件采用脉冲字线技术提高BTB读取速度,降低功耗。 (4) 建立功耗模型,指出常规TAG阵列、并行查询方式的低功耗瓶颈,X微处理器BTB部件采用新型的高速低功耗的TAG阵列设计和串行的查询方式,显著降低功耗。 (5) 针对BTB部件的功能需要,采用了随机替换算法以及两位饱和计数器算法,并给出电路实现,其电路结构简单,占用面积小。 (6) 阐述了BTB部件的版图实现技术,探讨了版图设计实现中的划分、布局、布线时应注意的问题,完成X微处理器BTB部件的版图设计与验证,并进行了寄生参数的提取及带寄生参数的电路线模拟。 本文研究的成果直接应用于X微处理器中,工程意义重大,研究中对全定制设计方法进行了探讨,为更高性能的微处理器设计积累了经验。
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